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Blog de la compañía Broadcom Ethernet PHY BCM87416:400G Transceptor PAM-4 PHY con TIA integrado y controlador láser

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Porcelana ShenZhen Mingjiada Electronics Co.,Ltd. certificaciones
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Broadcom Ethernet PHY BCM87416:400G Transceptor PAM-4 PHY con TIA integrado y controlador láser
últimas noticias de la compañía sobre Broadcom Ethernet PHY BCM87416:400G Transceptor PAM-4 PHY con TIA integrado y controlador láser

PHY de Ethernet de radiodifusiónSe trata de un sistema de control de las emisiones.: 400G PAM-4 Transceptor PHY con TIA integrado y controlador láser

 


Se trata de un sistema de control de las emisiones.es un transceptor PHY PAM-4 de 400GbE de bajo rendimiento y bajo consumo capaz de conducir directamente cuatro carriles de 106-Gb/s PAM-4 a 53 Gbaud, al tiempo que admite enlaces ópticos DR4/FR4/LR4.

 

Se trata de un sistema de control de las emisiones.aprovecha una plataforma de tecnología PHY de transceptores PAM-4 líder en el mercado y representa el primer PHY PAM-4 400G monolítico de la industria con amplificador de transimpedencia (TIA) integrado y controlador láser,desarrollado en CMOS de 7 nm. The Broadcom advanced DSP technology and equalization techniques compensate for optical impairments inside pluggable optical modules while maintaining the world’s lowest power to enable the deployment of 12.8 Tb/s y ASIC de conmutación de mayor densidad.

 

Se trata de un sistema de control de las emisiones.Incorpora un conjunto de características muy diferenciado, incluidos TIA integrado, controladores láser, opciones de capacidad FEC líderes en el mercado,y la interoperabilidad ASIC SerDes de los switches del lado del sistema para proporcionar una ventaja competitiva sin igual en el mercado.
En el modo 400GbE, the BCM87416 converts eight lanes of 53 Gb/s (at 26-Gbaud PAM-4) from the system side into four lanes of 106 Gb/s (at 53-Gbaud PAM-4) to directly drive next-generation high-density optical PAM-4 links inside QSFP-DD and OSFP form-factor modulesEl.

 

Se trata de un sistema de control de las emisiones.cumple las normas de la industria, incluidos los proyectos 400GBASE-DR4 y 100G-MSA 1.0 con capacidad de bypass de KP4 FEC y FEC.

 

La síntesis del reloj en el chip se realiza mediante un reloj de referencia de bajo costo de 156,25 MHz a través de bucles bloqueados por fase (PLL) de alta frecuencia y bajo jitter.

 

Características delSe trata de un sistema de control de las emisiones.
4 × 100G PAM-4 PHY impulsa 400GbE a través de la óptica
Apoya el modo de interrupción de DR4 a DR1 con capacidad de operación independiente del carril
Apoya el controlador láser integrado y el TIA integrado
Conformidad de las interfaces del lado del cliente: IEEE C2C y C2Mannels
Función de desvío FEC de extremo a extremo y KP4 conforme a la norma IEEE 802.3bs
Los ciclos de retroceso del lado de la línea y del sistema
Diseño CMOS de baja potencia de 7 nm

 

Las aplicaciones deSe trata de un sistema de control de las emisiones.
Infraestructura de red cableada
Modulos ópticos QSFP-DD/OSFP 400G
Se aplicará el procedimiento siguiente:

 

Diagrama de bloque deSe trata de un sistema de control de las emisiones.

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Tiempo del Pub : 2024-11-20 13:25:07 >> Lista de las noticias
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Persona de Contacto: Mr. Sales Manager

Teléfono: 86-13410018555

Fax: 86-0755-83957753

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